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W9825G6JH
11.17 Timing Chart of Read to Write Cycle
In the case of Burst Length = 4
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(1) CAS Latency=2
( a ) Command
DQM
Read
Write
DQ
( b ) Command
Read
D0
D1
Write
D2
D3
DQM
DQ
(2) CAS Latency=3
( a ) Command
Read
Write
D0
D1
D2
D3
DQM
DQ
( b ) Command
Read
D0
D1
Write
D2
D3
DQM
DQ
D0
D1
D2
D3
Note: The Output data must be masked by DQM to avoid I/O conflict.
11.18 Timing Chart of Write to Read Cycle
In the case of Burst Length=4
0
1
2
3
4
5
6
7
8
9
10
11
(1) CAS Latency=2
( a ) Command
DQM
Write Read
DQ
D0
Q0
Q1
Q2
Q3
( b ) Command
DQM
Write
Read
DQ
D0
D1
Q0
Q1
Q2
Q3
(2) CAS Latency=3
( a ) Command
DQM
Write Read
DQ
D0
Q0
Q1
Q2
Q3
( b ) Command
DQM
Write
Read
DQ
D0
D1
Q0
Q1
Q2
Q3
Publication Release Date: Mar. 13, 2014
- 38 -
Revision: A09
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